基于通信导航接收机数字基带芯片的后端设计技术研究与实现

admin · 发表于 2022-9-23 22:36:51

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本论文研究的是通信导航接收机的数字基带芯片的后端设计与实现，数字基带芯片是兼容GPS和BD2系统的导航接收机的重要部分，为我国发展独立自主的、具有国际先进水平的卫星导航系统奠定了基础，促进了我国卫星应用产业的发展。因为集成电路后端设计的优劣直接影响其性能、成本、功耗及流片的成功率，所以，数字基带芯片的后端设计十分重要。本论文中研究了芯片后端设计技术理论，包括整体和宏模块布局，电源网络布局，时钟树设计与综合，布线，时序优化，物理验证等关键技术，基于SMIC0.13μm工艺，利用Synopsys公司的后端设计工具Astro和版图验证工具Hercules，完成了约50万门的通信导航接收机的数字基带芯片的后端设计的研究与实现，实现了从门级网表到交付GDSII的整个芯片后端设计全过程，芯片已通过科工集团的验收，并已送交流片。论文中提出了先自主设计时钟树结构，再利用工具综合和优化时钟树结构的方案，得到比常规流程综合后更优的结果。为满足布局布线后的时序收敛条件，采用布局，时钟树综合，布线迭代反复的优化方法，布局布线后采用手动和工具相结合的插入缓冲器和ECO等方法来优化时序。同时完成了通信导航接收机数字基带芯片的物理验证。芯片最终通过了布局布线后仿真测试。

基于通信导航接收机数字基带芯片的后端设计技术研究与实现

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