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东 北 大 学 继 续 教 育 学 院
计算机数字逻辑基础X 试 卷（作业考核 线上2） B 卷（共 4 页）
总分 题号 一 二 三 四 五 六 七 八 九 十
得分
一、更多答案下载：雅宝题库QV同步1144766066网（www.ybaotk.com）。在备选答案中选出一个正确答案，并将所选答案填入下表。（20分）
题号 1 2 3 4 5 6 7 8 9 10
答案 D D A
01. 以下表达式中符合逻辑运算法则的是（ ）。
A.C•C=C2 B.1+1=10 C.0<1 D.A+1=1
02. 在何种输入情况下，“与非”运算的结果是逻辑（ ）。
A．全部输入是0 B.任一输入是0 C.仅一输入是0 D.全部输入是1
03．用四选一数据选择器实现函数 ，应使（ ）。
A.D0=D2=0，D1=D3=1 B.D0=D2=1，D1=D3=0
C.D0=D1=0，D2=D3=1 D.D0=D1=1，D2=D3=0
04. 图1所示电路，输出F为（ ）；
A、AB B、A+B C、A⊙B D、A÷B
05. 图2所示电路，输出F为（ ）；
A、A⊙B B、AB C、A+B D、A÷B
06. 图3电路为NMOS（ ）。
A、与非门 B、异或门 C、与或非门 D、或非门
07. 电路如图4所示，当X2X1X0=001时，F2F1F0=（ ）。
A、110 B、111 C、000 D、001
08. 电路如图4所示，当X2X1X0=011时，F2F1F0=（ ）。
A、110 B、101 C、100 D、011
09. 电路如图4所示，当X2X1X0=111时，F2F1F0=（ ）。
A、000 B、011 C、101 D、010
10. 图5所示电路，当EN=1时，（ ）。
A、 M为输入，N为输出 B、 N为输入，M为输出
C、 N为输入，EN为输出 D、 M为输入，EN为输出
二、填空题。（50分）
01. A+BC=（ ）；
02．常用于总线应用的电路（ TS ）门；
03. 二进制数11001转换成十进制数应为（ 25 ）；
04. 石英晶体多谐振荡器的突出优点是（ 振荡频率稳定
）；
05. 若在编码器中有50个编码对象，则要求输出二进制代码位数至少应为（ 6）位；
06. 一个16选一的数据选择器，其数据输入端有（ 16 ）个；
07. 要实现多输入、单输出逻辑函数，应选用（ 数据分配器
）；
08.对于D触发器，欲使Qn+1=1，应使输入D=（ .
）；
09.对于JK触发器，若J=K，则可构成（ Tˊ触发器 ）；
10.欲使D触发器按Qn+1= n工作，应使输入D=（ Q ）；
11. 可以产生延时的电路是（ ）；
12. 把一个五进制计数器与一个四进制计数器串联可得到（ 20 ）进制计数器；
13. 图6所示电路，D3D2D1D0=0000，A加高电平，C与B相连所构成的加法计数器是（ ）进制；
14. 图6所示电路，D3D2D1D0=0000，B加高电平，C与A相连所构成的加法计数器是（ ）进制；
15. 图6所示电路，D3D2D1D0=0010，A加高电平，C与B相连所构成的加法计数器是（ ）进制；
16. 图6所示电路，D3D2D1D0=0010，B加高电平，C与A相连所构成的加法计数器是（ ）进制；
17. 图6所示电路，D3D2D1D0=0110，A加高电平，C与B相连所构成的加法计数器是（ ）进制；
18. 图6所示电路，D3D2D1D0=0110， B加高电平，C与A相连所构成的加法计数器是（ ）进制；
19. 图7所示电路为（ ）电路；
20. 构成时序电路必须有(存储）电路；
21. 256×4的RAM构成容量为4K×8的RAM，需要的片数为（ 32 ）；
22.断电之后，能够将存储内容保存下来的存储器是（ROM ）；
23. 一个RAM芯片有10条地址线，8条输出线，该芯片能存储二进制数码的个数为（ 1024×8个 ）个；
24. 256×4的RAM构成容量为4K×8的RAM，需要的片数为（ 32 ）片；
25. 可以将足够幅度的正弦波变成方波的电路是（ 运放电路 ）；
三、试用卡诺图化简下列逻辑函数（10分）
雅关项：
雅关项：
四、（10分）试用图8所示输出低电平有效的3线-8线译码器和逻辑门设计一组合电路。该电路输入X，输出F均为三位二进制数。二者之间关系如下：
2≤X≤5时 F=X+2
X<2时 F=1
X>5时 F=0
五、（10分）试用图9所示74161采用预置端送0法构成十二进制计数器。
图9 |
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发表于 2021-4-12 20:23:17
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